一个从零开始写的极简、非常易懂的RISC-V处理器核。
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Verilog编写的RISC-V处理器，支持RV32IMZicsr指令集，2级流水线，哈佛结构，AXI4-Lite总线。MCU级别的处理器，麻雀虽小，五脏俱全。riscv有无限可能，未来将不断完善，大家的支持是我前进的动力。
基于PaddlePaddle实现的SSD，包括MobileNetSSD，MobileNetV2SSD，VGGSSD，ResNetSSD
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