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fb1103/basic_verilog

forked from yhp/basic_verilog 
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bin2gray.sv 759 Bytes
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Konstantin Pavlov 提交于 2020-02-25 15:38 . Added gray code converters
//------------------------------------------------------------------------------
// bin2gray.sv
// Konstantin Pavlov, pavlovconst@gmail.com
//------------------------------------------------------------------------------
// INFO ------------------------------------------------------------------------
// Gray code to binary converter
// Combinational design
/* --- INSTANTIATION TEMPLATE BEGIN ---
bin2gray #(
.WIDTH( 32 )
) BG1 (
.bin_in( ),
.gray_out( )
);
--- INSTANTIATION TEMPLATE END ---*/
module bin2gray #( parameter
WIDTH = 32
)(
input [WIDTH-1:0] bin_in,
output logic[WIDTH-1:0] gray_out
);
always_comb begin
gray_out[WIDTH-1:0] = bin_in[WIDTH-1:0]^(bin_in[WIDTH-1:0]>>1);
end
endmodule
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https://gitee.com/fb1103/basic_verilog.git
git@gitee.com:fb1103/basic_verilog.git
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