对应实验手册请参阅[《LoongArch CPU设计实验》](https://bookdown.org/ghostboy316/bookdown/chapter-fpga-board.html)。

NOTE: 
  1. minicpu_env/miniCPU/目录下的代码功能不全，是有意为之，无需提issue修正。
  2. mycpu_env/myCPU/目录下的代码有功能错误，亦是有意为之，无需提issue修正。


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实验安排简介
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// dc_env
exp1  : 跑马灯实验。熟悉Vivado和FPGA实验环境基本使用技能。
exp2  : 寄存器堆仿真；
exp3  : 同步、异步 RAM 仿真、综合实现；
exp4  : 数字逻辑电路的设计与调试。

// minicpu_env
exp5  : 5条指令单周期CPU，跑斐波那契数程序，给RTL填空方式。

// mycpu_env  -  soc_dram i/f (distributed ram interface) 
exp6  : 20条指令单周期CPU，测试规模缩减版func的n1~n20，给RTL找错误并修正。

// mycpu_env  -  soc_bram i/f (block ram interface)
exp7  : 20条指令五级流水CPU，不考虑hazard，测试插NOP的func的n1~n20，增量开发。
exp8  : 20条指令五级流水CPU，cancel解决control hazard，阻塞解决data hazard，测试
        func的n1~n20，增量开发。
exp9  : 20条指令五级流水CPU，forward优化data hazard处理，测试func的n1~n20，增量
        开发。
exp10 : 增加用户态运算类指令，测试func的n1~n36，增量开发。
exp11 : 增加用户态转移指令和除了ll.w、sc.w之外的用户态访存指令，测试func的n1~n46，
        增量开发。
exp12 : 支持syscall例外，测试func的n1~n47，增量开发。
exp13 : 支持更多例外，测试func的n1~n58，增量开发。

// mycpu_env  -  soc_hs_bram i/f (handshaking block ram interface)
exp14 : CPU采用带握手机制的接口，测试func的n1~n58，增量开发。

// mycpu_env  -  soc_axi i/f (AXI bus interface)
exp15 : CPU采用AXI接口，外部固定延迟响应，测试func的n1~n58，增量开发。
exp16 : CPU采用AXI接口，外部随机延迟响应，测试func的n1~n58，增量开发。
exp18 : CPU集成TLB模块后并支持TLB相关指令和CSR，测试func的n1~n70，增量开发。
exp19 : CPU支持TLB MMU功能，测试func的n1~n72，增量开发。
exp21 : CPU实现指令Cache，测试func的n1~n72，增量开发。
exp22 : CPU实现数据Cache，测试func的n1~n72，增量开发。
exp23 : CPU支持CACOP指令，测试func的n1~n79，增量开发。

// mycpu_env  -  module_tlb 
exp17 : TLB模块设计，非func测试，单独开发。

// mycpu_env  -  module_cache
exp20 : Cache模块设计，非func测试，单独开发。